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実行される命令は、命令フェッチ、命令デコードなどのようにいくつかの段階に分割する必要があることを誰もが知っています........

パイプライン命令プロセッサでは、すべてのステージが 1 サイクルで実行され、1 サイクルで実行される異なる命令に対して異なるステージが実行される場合があります (異なるステージで命令が重複します)。

パイプライン処理されていないプロセッサでは、命令は順次実行されます (オーバーラップはありません) 。私の質問は、パイプライン処理されていないプロセッサでは、命令が 1 サイクルで完全に (すべての段階で) 実行されるか、またはその各段階が 1 サイクルで実行されますか?

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各命令を 1 サイクルで評価するパイプライン化されていない CPU を実装することは間違いなく可能です。たとえば、J1 コアを参照してください。データはクロックの立ち上がりエッジでブロック RAM からフェッチされ、ライトバックは立ち下がりエッジで実行されます。

命令は、クリティカル パスを短くする (およびクロック レートを適度に高くする) ほど簡単です。

ただし、歴史的なRISC以前のコアのほとんどは、マルチサイクルでした。ここでは、そのような CPU の典型的な設計について説明します

于 2013-04-08T08:22:54.793 に答える