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私は2つの問題に悩まされています。問題の関連する詳細を含めます。ガイダンスをいただければ幸いです。できれば説明をお願いします。

メモリ階層にいくつかの異なる選択肢があるプロセッサについて、次の統計があるとします。

Base CPI = 1.5 
Processor Speed = 2 GHZ
Main Memory Access Time = 100ns
L1 miss rate per instruction = 7%
L2 direct mapped access = 12 cycles 
Global miss rate with L2 direct mapped = 3.5%
L2 8-way set associative access = 28 cycles 
Global miss rate with L2 8-way set associative access = 1.5%

注：グローバルミス率は、すべてのレベルのキャッシュでミスする（したがってメインメモリにアクセスする必要がある）参照の割合です。

  1. L2キャッシュが使用可能であり、直接マッピングされている場合は、合計CPIを計算します。

  2. L2が利用可能で、8ウェイセットアソシアティブである場合は、合計CPIを計算します。

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2 に答える 2

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私は今問題を理解しているので、より多くの情報でフォーラムを改善するためにここでそれを説明したと思いました。

初め、

合計CPI=基本CPI+メモリ-命令あたりのストールサイクル

命令ごとのメモリストールサイクル=ミスペナルティ（サイクル単位）xミスレート

ビジネスの最初の順序は、2番目のキャッシュがなかった場合のミスペナルティを把握することです。これは、次の計算によって簡単に決定されます。

メインメモリアクセス時間/（1 /プロセッサ速度）=（100）/（.5）=200サイクル

注：メインメモリのアクセス時間はns単位であり、プロセッサ速度の逆数はns /サイクルで表されるため、2つを除算することでサイクル数が得られます。この計算を行っているのは、メインメモリに到達するまでに一定の時間がかかり（100ns）、プロセッサの速度によって移動速度（2GHz）が決まり、クロック速度を反転によってクロックレートに変更することで計算できるためです。メインメモリに移動するために必要なサイクル数（ミスペナルティ）。

問題には2つのキャッシュが関係しているため、L1にミスがあると、L2から情報を取得しようとします。それでも情報が見つからない場合は、メインメモリにアクセスするため、フローは次のようになります。

アクセスL1----->アクセスL2----->アクセスメインメモリ

（「ヒット」が発生した場合、フローを続行する必要がないことを意味します）

この問題は、L2直接マップアクセスにかかる時間=12サイクルであることを示しています

したがって、計算は次のようになります。

合計CPI=1.5 +（0.07 x 12）+（0.035 x 200）= 9.34 CPI

7％の時間を逃すため、L2にアクセスする必要があり、12サイクルかかるため、2を掛けます。それでも見つからない場合は、メインメモリにアクセスする必要があります。これには200サイクルかかり、グローバルミス率は3.5％です。

総消費者物価指数=1.5+（0.07 x 28）+（0.015 x 200）= 6.46

2番目の計算も同様の方法で行われます

于 2012-04-18T04:36:14.137 に答える
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最初の質問への回答の一部は、解釈に基づいています。キャッシュレベルが1つしかない場合は、CPIを計算することになっていると思いました。それは物事を大きく変えます...

  1. システム内のL1キャッシュのみ

    ミスペナルティ=100ns/（1 / 2GHz）=200サイクル第1レベルのキャッシュCPI= 1.5 +（0.07 * 200）= 15.5

  2. L2ダイレクトマップキャッシュ

    L1ミス、L2ヒットペナルティ=12サイクル両方のミスペナルティ=12 + 200=212サイクル合計CPI=1.5 +（0.07 * 12）+（0.035 * 212）= 9.76

  3. L28ウェイセットアソシアティブキャッシュ

    L1ミス、L2ヒットペナルティ=28サイクル両方のミスペナルティ=28 + 200=228サイクル合計CPI=1.5 +（0.07 * 28）+（0.015 * 228）= 6.88

そして、これは、パターソンとヘネシーによる第5版のコンピューター組織と設計の問題5.7.4です。

于 2016-02-24T22:18:30.213 に答える