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レコードであるいくつかの出力でVHDLブロックをインスタンス化するトップレベルのVerilogモジュールがあります。
Verilogトップからこれらのレコードにアクセスする良い方法はありますか、それとも単にレコードを分割する方が良いですか?
できます(注意が必要です)。「レコード」と同じタイプの「構造体」を作成します。接続を並べ替えない限り、これら2つは1:1でマップされます。ツールが実際にそれをサポートしているかどうかに注意してください。