シグナルを定義せずに vhdl コンポーネントを直接接続する方法はありますか?
最初のブロックの出力を他に使用せずに2つのブロックが接続されている場合だけですか?
コンポーネントのインスタンス化を接続するには、シグナルを宣言する必要があります。Sigasi はこれを自動的に行うことができます: demo .
できません (現在 - 「推測された接続」を許可する可能性のある将来の改訂が考えられています)。
ただし、Emacs の VHDL モードや Sigasi などのツールを使用すると、これをはるかに簡単に行うことができますが、ボイラープレート コードが生成されます。
(x)emacs をVHDL モードで使用する場合:
1) カーソルを VHDL エンティティに置きます
2) MX vhdl ポート コピー
信号を生成する
3) MX vhdl-port-paste-signals
注: vhdl-port-paste-[コンポーネント|エンティティ|定数|インスタンス|...]