Verilog および VHDL では、ツールへの RTL コマンドは、疑似コメントとしてプラグマ ディレクティブとして指定できます。実際のコメントでこれらのプラグマ ディレクティブを使用することは避けたいので、プラグマ ディレクティブ トリガーの包括的なリストが必要です。私が知っているものは次のとおりです。
-- pragma
// synthesis
-- synopsys
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ここで包括的なリストを見つけることができます：
http://www.sigasi.com/content/list-known-vhdl-metacomment-pragmas
トリガーで始まるコメントがない限り、つまり、-- <trigger> ...安全です。
たとえば、Altera Quartus を使用する場合、次のようなコメントは避けてください。
-- altera code below、
その間
-- The following is for altera.
大丈夫でしょう。
于 2013-04-18T15:29:55.903 に答える