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キーの長さが 128 ビットの AES 暗号化アルゴリズムを実装するには、VLSI Systolic 配列を生成する必要があります。可能な方法は次のとおりです。

  1. キー拡張のためのシストリック
  2. MixColumn の収縮期
  3. S-box のオンザフライ計算のための収縮期

オプション #3 については、このペーパーを参照しています。この論文の図 2.1 は、S-box 計算の最初のステップである乗法逆数を計算する手順を示しています。このダイアグラムを収縮配列に変換しようとしていますが、今まで具体的な解決策に達していません。

また、循環アルゴリズムをシストリックアルゴリズムに変換するためにこの論文を参照しています。ただし、AES 暗号化に関連する操作を Systolic 構造に変換することはできません。この問題にアプローチする方法について、誰かが私に何か指針を教えてもらえますか?

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