vhdl - VHDL での整数とバイナリの比較

Question

if ステートメントで整数値とバイナリ値を比較できますか。つまり、次のような比較ステートメントがあります。

 if(o_remainder=remainder and o_quotient=quotient)

ここでo_remainder、とo_quotientは型std_logic_vectorであり、remainderとquotientは型integerです。

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std_logic_vector についての言及から、実際には Verilog ではなく VHDL で作業していると思います。

ベクトルが数値を表す場合は、ベクトルの代わりに ieee.numeric_stdのunsignedまたは型を使用します。signed次に、整数と直接比較できます。

std_logic ベクトルの使用を主張する場合は、前に変換します。

 if unsigned(some_vector) < some_integer then

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