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module - 予期しない高インピーダンス状態

モジュールの出力ポートで予期しない高インピーダンス状態の問題が発生しました。他のモジュールをインスタンス化するモジュールのコードは次のとおりです。

インスタンス化可能なモジュールのポート宣言は次のようになります。

出力の割り当ては初期ブロックで行われ、次のようになります。

したがって、問題は、AMOUNT_OF_REGIONS == 3 または 2 の場合、すべて正常に動作しますが、その値を増加させようとすると、1 と AMOUNT_OF_REGIONS-2 (を含む) の間のすべての領域に対して、それらの入力と出力がめちゃくちゃです (2'bzz)。しかし、0 リージョンはリージョン 1 に情報を送信し、AMOUNT_OF_REGIONS-1 リージョンは情報を適切に隣人に送信します。テスト ベンチは、列をインスタンス化するだけで、トリガーと clk 信号を生成します。高インピーダンス状態を引き起こす可能性のあるレジスターへの接続のないワイヤー接続のみがある場合、私は読んだことがありますが、私が見る限り、私はワイヤーを出力レジスターに接続しています...それの問題?問題があれば、Icarus Verilog を使用しています。