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x86 - インテルが最適化リファレンス マニュアルから 16 バイトの分岐ターゲット アラインメント コーディング ルールを削除したのはなぜですか?
インテル® 64 および IA-32 アーキテクチャー最適化リファレンス・マニュアルの以前のバージョンには、次のコーディング規則が含まれていました。
アセンブリ/コンパイラ コーディング ルール 12. (M の影響、H の一般性)
すべての分岐ターゲットは 16 バイト アラインされている必要があります。
2020 年 5 月版にはこのルールはありません。なぜ削除されたのですか？
ここLinux カーネル メーリング リストで説明されているように、16 バイトへのアライメントにはコストがかかります。しかし、これは長年の規則であり、ARM はマイクロアーキテクチャに対して同じ規則を持っています。
サブルーチンのエントリ ポイントと分岐ターゲットをクワッドワード (16 バイト) 境界に揃えることを検討してください。
AMD ファミリ 17h プロセッサ用の AMD のソフトウェア最適化ガイドには、次のように記載されています。
分岐ターゲットを 16 バイトに揃えることで、最大のピッカー スループットが得られ、キャッシュラインの終わりの短い op キャッシュ (OC) エントリが回避されます。