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ザイリンクスSimulinkで信号の絶対値を取得する必要があります。

mcodeブロックを使用して、matlabコードを記述してそれを実現できます。しかし、それを行うためのより良い方法があるかどうかだけ興味があります。

Simulink（ザイリンクス）を使用するのは初めてです。ザイリンクスライブラリのSimulinkのようなabsブロックはありますか？

ありがとう

本当に2つの質問ですが、もっと説明的にしたいと思います:

複雑なベクトルの行列乗算を含む変調器を実装しています:

例を挙げると：

基本的に、これを Simulink (Xilinx) で、最終的にハードウェアで実装する必要があります。

私の質問は、複雑なベクトルを使用して行列乗算をモデル化する方法です。私の理解は、Complex Multiplierを使用することです。しかし、それは2つの複素ベクトルのみを乗算することです

1 つのクロックで 2 つ以上の複素数ベクトルを乗算する必要がある場合、それは可能です。

モデル自体のような答えは期待していませんが、問題を解決するためのアプローチ/方向性があれば

読んでくれてありがとう、キラン

DQPSK Demodulator（タイプ：UFix2_0）から出力される入力ワードをシリアルストリームに変換しようとしています。

そのため、SimulinkでザイリンクスライブラリのParallel-to-Serialブロックを使用しています。

しかし、ブロックを使用できません。次のエラーが発生します。

このSystemGeneratorトークンの「Simulinkシステム期間」設定は、設計で使用されるレートには適切ではありません。

現在の設定は次のとおりです。1適切な設定は次のとおりです。1/2"

System Generatorの設定も変更しようとしましたが、うまく機能していないようです。

私がどこで間違っているのか考えてみてください。他のアプローチも同様に役立ちます。

ありがとう

これは私の以前の質問の繰り返しに見えるかもしれません。しかし、そうではないと思います。10 進数形式の信号を 2 進数形式に変換する手法を探しています。

ザイリンクス ライブラリの Simulink ブロックを使用して、10 進数をバイナリ形式に変換する予定です。

したがって、入力が 3 の場合、予想される出力は 11 (2 クロック サイクル) である必要があります。シリアルに取得される出力を探しています。

それを行う方法を教えてください。または、インターネット上のポインタが役に立ちます。

ありがとう

simulinkの単純なモデルからネットリストを生成しようとしていました。シミュレーションを実行できます（sysgenを使用）。

ネットリストを作成しようとすると、エラーがスローされます：

" *エラー*

ネットリストの生成中にエラーが発生しました。19の概要ファイルで==>xlProcBlockElaborateBMMを使用中にエラーが発生しました'C：\ <..> \ Timing \ synopsis' not found "

そこで、あらすじフォルダを手動で作成しようとすると、次のエラーがスローされ始めました。

* エラー *

ネットリストの生成中にエラーが発生しました。Java例外が発生しました：com.xilinx.sysgen.netlist.NetlistInternal：java.io.FileNotFoundException：C：\ Kiran \ Timing \ synopsis \ synopsis（アクセスが拒否されました）com.xilinx.sysgen.netlist.XTable.valueOf（不明なソース）com.xilinx.sysgen.netlist.Block.fromXTable（不明なソース）

管理者としてMatlabを実行してみましたが、同じ結果になりました。ここで何かが足りない場合はお知らせください。

だから、ここに設定の詳細があります：

Matlabバージョン：バージョン7.10（R2010a）
ザイリンクスシステムジェネレーターバージョン12.2

ザイリンクスのフォーラムで解決策が見つからなかったので、ここに投稿します。

ありがとう

私は USRP2 に取り組んでおり、デバッグ メッセージを読みたいと思っています。背面にシリアルポートがあります。

標準の USB から 3.3v レベルのシリアル コンバーターに接続します。しかし、メッセージを読むためにどのツールを使用すればよいかわかりません。

仕様によると、230400 ボーでデバッグ詳細メッセージを読み取ることができました。

Windows でハイパーターミナルを使用できますか? サードパーティのツールや Linux のツールも役に立ちます。

ありがとう

gnuradio-companion から wlan サンプルを取得しようとしています。USRP ソースを次のように構成しました。

• Ch0 ゲイン = 50dB
• デバイスアドレス: 192.168.10.3
• 中心周波数: 2.437GHz
• サンプルレート：11M

しかし、モデルを実行すると、コンソールにオーバーフロー メッセージが表示されます。構成がサンプルの収集に適しているかどうかのヒントはありますか?

添付のモデルは次のとおりです。

2012a または 2011b と System Generator 13.1 を使用して、simulink でコシミュレーションを行っています。ハードウェアを zynq fpga にロードするためのライブラリ ブロックをビルドするときに、システム ジェネレーターを「Hardware Co-Sim」になるように構成すると、この手順のすべてが機能します。ただし、シミュレーションの simulink/pc 側では、構成方法に関する適切なリソースが見つかりませんでした。 他のセットアップ (HDL ネットリスト) などではなく、ハードウェア co-sim としても設定する必要があると想定するのは正しいですか?

現在、システムは問題なくブロックをロードしているようですが、jtag ライブラリがありません。これが sysgen の問題なのか、ソフトウェアのバージョン管理の問題なのかは不明です。私の理解では、sysgen は 2012a ではまだベータ版です。

前もって感謝します。

Spartan 6 の HW Cosimulation を使用して、レーダー パルス圧縮用のシステム ジェネレーター モデルを作成しています。

インターネット上には、私が見つけたいものに近い 3 つの研究論文があります。

モデルは研究論文で見ることができます。

2 つは時間領域圧縮に FIR フィルターを使用し、3 つ目は周波数領域圧縮に FFT を使用していますが、モデル全体を完成させて Core gen を使用して FIR または FFT を生成することはできません。

誰かがモデルを理解するのを手伝ってくれませんか? それ以外の場合は、誰かが以前にそれに取り組んでいて、モデル ファイルを提供してくれれば、それは本当に役に立ちます。

PS。時間領域モデルはほぼ完成しましたが、FIR フィルターの係数を見つける方法がわかりません。

ありがとうございました。気長に返事待ち。

3 つの研究論文へのリンクは、私が同じ質問をした別のサイトにあります。管理者が否定しないことを願っています。 http://forums.xilinx.com/t5/DSP-Tools/Pulse-Compression/mp/404871#M7586

画像処理に DIGILENT の Atlys FPGA ボードを使用していますが、1 つの問題に直面しています。それは、ブラック ボックスを使用してソフトウェア協調シミュレーションを実行するときです。出力はすぐに得られます。つまり、1 分以内ですが、ハードウェア協調シミュレーション モデルを生成するときです。ハードウェア協調シミュレーションに使用すると、出力に 20 ～ 30 分かかります。どうしてこれなの？そして、この長い時間をどう乗り切るか？