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riscv - 32 ビット データパス RISCV コア
PublicConfig.scala の構成を変更して、ロケット コアをパラメータ化しようとしています。
しかし、XprLen と L1D_SETS を 32 に変更すると、コンパイルの問題が発生します。
可能であれば、Rocket Chip Generator で 32 ビット データ パスを生成する適切な方法は何ですか?
scala - ノミの取り付け
私はチゼルの新しいユーザーです。チゼルを自分のマシンに取り付けようとしました。gitによると、最初に chisel のクローンを作成し、次に hello ディレクトリに移動してmake. しかし、私は以下のエラーを得ました:
私はsbt-0.13.8とscala 2.11.6を使用しています
chisel - チゼル モジュールの条件付きポート
通常は必要のない選択可能な機能があります。ただし、この機能をサポートするには、元のモジュール I/O ポートにいくつかの I/O ポートを追加する必要があります。
私はこのようにしています：
sbt "run TestModule --backend c --compile --test --genHarness" を実行した後、コンパイラは次のように文句を言います:
したがって、if ステートメントは効果がありません。val io は、拡張された IOBoundle_EXT ではなく IOBundle にまだ割り当てられているため、意味がありません。
scala - 32 ビット RISCV フォームのみのソースを生成する方法を教えてください。必要な変更は何ですか?
RISCV ツールチェーンによると、Rocketchip の Verilog ファイルを 64 ビットとして生成しています。ただし、32 ビットの RISCV ロケット チップが必要です。そのためには、scala ファイルと chisel ファイルの要件と変更が必要です。
そのために 32 ビットの Rocket コアを生成することは可能ですか。
gcc - riscv-gcc コンパイル時のエラー
riscv-gcc を使用したい。https://github.com/riscv/riscv-gccから取得しましたが、コンパイルすると以下のエラーが発生しました
../../../../build-gcc-newlib-src/libgcc/../gcc/libgcc2.h:139:1: error: no data type for mode 'TI'
In file included from ../../../../build-gcc-newlib-src/libgcc/../gcc/libgcc2.c:57:0:
../../../../build-gcc-newlib-src/libgcc/../gcc/libgcc2.h:138:1: error: no data type for mode 'TI'
../../../../build-gcc-newlib-src/libgcc/../gcc/libgcc2.h:139:1: error: no data type for mode 'TI'
In file included from ../../../../build-gcc-newlib-src/libgcc/../gcc/libgcc2.c:57:0:
../../../../build-gcc-newlib-src/libgcc/../gcc/libgcc2.h:138:1: error: no data type for mode 'TI'
何が問題なのかわからず、このリビジョンを使用して FlexPRET プロジェクトをビルドしましたが、最新のリビジョンは FlexPRET と互換性がありません。