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simulation - フリップフロップ D ISim 12.3 のシミュレーション
この vhdl コードを ISim 12.3 でシミュレーションするにはどうすればよいですか。FPGA にダウンロードしたので動作することはわかっていますが、適切なシミュレーションが表示されません。
基本的すぎる場合は申し訳ありませんが、私はこれに非常に慣れていません。
これは私のテストベンチがどのように見えるかです
perl - Perl: フリップフロップ関数を使用してブロック読み取り内からデータを抽出する
@mytitles
たとえば、などの多くのタイトルを含むtitle1
という配列がありますtitle2
。Superdataset
各タイトルに関する情報を含む「 」というファイルがあります。ただし、に関連する情報title1
は 6 行の場合があり、の情報はtitle2
30 行 (ランダム) の場合があります。titlex
( a の)各情報は " " で始まり " Reading titlex
" で終わりDone reading titlex
ます。
各タイトルのこれらの情報行から、いくつかのデータを抽出する必要があります。Done reading titlex
この必要なデータが毎回" " の直前の 2 行にあるのはラッキーだと思います
したがって、私の " Superdataset
" は次のようになります。
経費の総額と収入の総額が必要です。助言がありますか?PS-配列には複雑な名前が付けられており、次のような単純なものではありませんtitlex
perl - Perl では、フリップフロップ演算子を使用して直接キャプチャしたデータに「grep」コマンドを適用できますか?
コマンドの出力に含まれる特定の単語 (C7STH、C7ST2C) の出現回数を見つける必要があります。コマンドは「固定」テキストで開始および終了します - 以下のように START & END です。このコマンドは、ログ ファイル内のさまざまなノードに対して何度も繰り返されます。
...
....
各コマンド出力を取得するためにフリップフロップ演算子 (if (/^START$/ .. /^END$/) を使用しています。
行ごとに移動せずに、このデータに対して「grep」を実行する方法はありますか? 同様に、「START」と「END」の間のすべてのテキストを配列に取得し、これに対して「grep」を実行できますか?
また、パフォーマンスの観点から、フリップフロップ演算子を使用して複数レベルの if ブロックを使用しても問題ありませんか?
perl - Perlフリップフロップ演算子-最初の一致のENDを次の一致の開始として扱うことは可能ですか?
フリップフロップ演算子についてさらにサポートが必要です。以下は私のサンプルデータです。
関心のあるデータは、文字列'LS SPID ASP SPID'で始まり、次の'LS SPID ASP SPID'またはEND(次のLS行がない場合)で終わります。フリップフロップ演算子を使用してこれを取得することは可能ですか?このデータを配列(@linesread)に読み込んでから、以下のコードを使用して配列をループしようとしましたが、機能していません。同じ行を2回ループできないため、問題が発生しますか?他の解決策はありますか?
PS:必要に応じて...演算子を使用しています。
vhdl - VHDL の D フリップフロップ
私が書いた D ラッチを使用して、VHDL で D フリップフロップを実装しようとしています。しかし、時計に誤差があるようで、それが何なのかわかりません。
これが私のDラッチのコードです。
私はそれをテストし、動作しました。これが私の d フリップフロップのコードです。
ここにエラーがあります:
ありがとうございました
perl - Perlフリップフロップ演算子-グローバル状態の問題?
フリップフロップ演算子を使用してテキスト解析を行っていますが、データは次のようになります。
ここで、このデータを反復処理する必要があり、各CELLについて、COUNTER2の合計を見つけます。ご覧のとおり、各セルの下には1つ以上のCOUNTER行がある可能性があります。以下のようなフリップフロップ演算子を使用してみましたが、機能しません。
これは、この質問で説明したフリップフロップオペレーターのグローバルな状態と何か関係があると思いますが、あまり理解できませんでした。私を助けてください。
よろしくお願いします。
memory - フリップフロップ、ラッチの基本概念
誰かがこれを手伝ってくれることを願っています。フリップフロップの効用のポイント、状態を保存するポイントを取得できません。以前の状態を保存したい場合は、入力をそのまま維持してみませんか。一般に、なぜこのようになっていないのですか。たとえば、入力=出力を使用してゲートを使用しないでください。または、出力を提供した後、入力をゼロにして他の目的に使用し、出力を維持できるという事実のために、フリップフロップがメモリストレージで使用されていますか?
clock - デューティサイクルを変更せずに時計を3で割りますか?
たくさん検索しましたが、良い解決策が見つかりませんでした。ほとんどの回答は、デューティサイクルが50%の場合にのみ機能しますが、40%などのデューティサイクルのクロックで機能するソリューションを探しています。
language-agnostic - 8近傍座標を生成する最もクリーンな方法
次の一連の数値を生成する方法を探しています (これは、北西ピクセルから始まり西ピクセルで終わる、ピクセルの 8 つの隣接ピクセルの相対座標です)。最初の数値は y 座標で、2 番目の数値は x 座標です。
座標を配列に入れるなど、これを達成するためのいくつかの醜い方法を思いつくことができますが、考えもしなかったクリーンで効率的な方法があるかどうか疑問に思っています。
編集:実装しようとしているアルゴリズムの設計方法により、ピクセルはその特定の順序(NWからW)で反復する必要があります。
vhdl - 不要な 1 ビット ラッチ (VHDL)
N ビットの復元しない分周器をプログラミングしていますが、ちょっとした問題に直面しました。
操作部分 (組み合わせ) と制御部分 (有限状態マシン) があります。制御部には 2 つのプロセス FSM があり、1 つは次の状態を更新するため、もう 1 つは「状態シーケンス」用です。
これが 2 番目のプロセスです。
ご覧のとおり、sub の値を変更する必要があるのは 2 つのケース (減算とテスト) のみですが、他のケースでは変更する必要はありません。
問題は、このコードを合成しようとすると、sub_tmp が LATCH であることが判明することですが、ラッチは必要ありません。私はこのようなことをする必要があります:
状態 1 => サブを '1' または '0' に設定 (別の入力に応じて)
状態 2 => 他の操作を行い (ただし、sub は以前に設定された値のままにしておく必要があります)、状態 1 に戻ります。
さらに明確にするために、FSM の特定の状態 (すべてではない) で、変数の値を設定します (sub_tmp と呼びましょう)。他の州では、その値を変更しません。次に、「sub_out」という出力 PIN があるとします。ここで、変数の値とは別に、その値をこのピンに出力したいと思います (sub_out <= sub_tmp; など)。
私は何が欠けていますか?